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DS90CR482VS/NOPB

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DS90CR482VS/NOPB TI

Hersteller:
TI
Hersteller-Nr:
DS90CR482VS/NOPB
AiPCBA-Teilenummer:
CM60675500
Preis (EUR):
€

15.23
AiPCBA-Lager:
1,782 Stk
Versendet von:
Verfügbarkeit:
1,082 Stück auf Lager

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Produktkategorie:
LVDS, M-LVDS, ECL, CML
Produktbeschreibung:
LVDS Deserializer 672Mbps 100Pin TQFP Tube
Dokumentation:
Datenblatt
3D-Modell

DS90CR482VS/NOPB Kaufen DS90CR482VS/NOPB Bestand & Preis aktualisiert um 2025-06-16 03:50:22

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Teilenummer: DS90CR482VS/NOPB

AiPCBA P/N: CM60675500

Hersteller: TI

Paket: TQFP-100

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Erinnerungen zur Betrugsprävention

Kürzlich haben wir festgestellt, dass Kriminelle vorgaben, AiPCBA zu sein, um zu betrügen oder zu versuchen, Fälschungen zu verkaufen ausgefallene Komponenten zu günstigen Preisen.

AiPCBA hat ein Komponentenprüflabor im Jahr 2021 mit dem Ziel, qualitätsgesicherte Komponenten bereitzustellen.

Wir empfehlen unseren Kunden dringend, sich für zuverlässige Komponentenlieferanten zu entscheiden.

Bitte beachten Sie, dass die einzigen offiziellen Website- und E-Mail-Suffixe sind aipcba.com

DS90CR482VS/NOPB Spezifikationen Ähnliche Produkte anzeigen (99+)

TYP

BESCHREIBUNG

AUSWÄHLEN

Hersteller

TI

Kategorie

LVDS, M-LVDS, ECL, CML

3D-Modell

3D-Modell

Montagesmethoden

Surface Mount

Anzahl von Pins

100 Pin

Verpackung

TQFP-100

Netzspannung

3.30 V

Ausgang-Schnittstellen

48 Output

Verlustleistung

2.3 W

Datenübertragungsrate

672 Mbps

Verlustleistung

825 W

Eingangsspannung (Min)

100 mV

Eingangsstrom (Min)

15 μA

Anzahl der Eingänge

8 Input

Betriebstemperatur (max.)

70 ℃

Betriebstemperatur (Min)

-10 ℃

Verlustleistung (max)

2300 mW

Versorgungsspannung

3V ~ 3.6V

Versorgungsspannung (max.)

3.6 V

Versorgungsspannung (Min)

3 V

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Ansicht

Größe & Paket

TYP

BESCHREIBUNG

Länge

14 mm

Breite

14 mm

Höhe

1 mm

Betriebstemperatur

-10℃ ~ 70℃ (TA)

Produktlebenszyklus

Active

Verpackungsmethoden

Tray

DS90CR482VS/NOPB Datenblatt >

Umwelt

TYP

BESCHREIBUNG

RoHS-Standard

RoHS Compliant

Bleifreier Status

Lead Free

DS90CR482VS/NOPB Datenblatt >

Exportklassifikationen

TYP

BESCHREIBUNG

ECCN Code

5A991.b.1

DS90CR482VS/NOPB Datenblatt >

Funktionsübersicht

The DS90CR481 transmitter converts 48 bits of CMOS/TTL data into eight LVDS (Low Voltage Differential Signaling) data streams. A phase-locked transmit clock is transmitted in parallel with the data streams over a ninth LVDS link. Every cycle of the transmit clock 48 bits of input data are sampled and transmitted. The DS90CR482 receiver converts the LVDS data streams back into 48 bits of LVCMOS/TTL data. At a transmit clock frequency of 112MHz, 48 bits of TTL data are transmitted at a rate of 672Mbps per LVDS data channel. Using a 112MHz clock, the data throughput is 5.38Gbit/s (672Mbytes/s). At a transmit clock frequency of 112MHz, 48 bits of TTL data are transmitted at a rate of 672Mbps per LVDS data channel. Using a 66MHz clock, the data throughput is 3.168Gbit/s (396Mbytes/s).
The multiplexing of data lines provides a substantial cable reduction. Long distance parallel single-ended buses typically require a ground wire per active signal (and have very limited noise rejection capability). Thus, for a 48-bit wide data and one clock, up to 98 conductors are required. With this Channel Link chipset as few as 19 conductors (8 data pairs, 1 clock pair and a minimum of one ground) are needed. This provides an 80% reduction in cable width, which provides a system cost savings, reduces connector physical size and cost, and reduces shielding requirements due to the cables" smaller form factor.
The 48 CMOS/TTL inputs can support a variety of signal combinations. For example, 6 8-bit words or 5 9-bit (byte + parity) and 3 controls.
The DS90CR481/DS90CR482 chipset is improved over prior generations of Channel Link devices and offers higher bandwidth support and longer cable drive with three areas of enhancement. To increase bandwidth, the maximum clock rate is increased to 112 MHz and 8 serialized LVDS outputs are provided. Cable drive is enhanced with a user selectable pre-emphasis feature that provides additional output current during transitions to counteract cable loading effects. Optional DC balancing on a cycle-to-cycle basis, is also provided to reduce ISI (Inter-Symbol Interference). With pre-emphasis and DC balancing, a low distortion eye-pattern is provided at the receiver end of the cable. A cable deskew capability has been added to deskew long cables of pair-to-pair skew of up to +/−1 LVDS data bit time (up to 80 MHz Clock Rate). These three enhancements allow cables 5+ meters in length to be driven.
The chipset is an ideal means to solve EMI and cable size problems associated with wide, high speed TTL interfaces.

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- Sorgfältig geprüft und verpackt von AiPCBA
- Vakuumverpackung
- Antistatische Verpackung
- Antivibrationsschaum
- Einkommensqualitätskontrolle (IQC), über 800 qualifizierte Vertriebspartner.
- 500 m² Labor für fortschrittliche Komponententests, Fälschungserkennung, RoHS-konform usw.
- 2000 m² digitales Komponentenlager, konstante Temperatur und Luftfeuchtigkeit
- Entkapselungsinspektion
- Röntgeninspektion
- XRF-Inspektion
- Elektrische Prüfung
- Oberflächenprüfung
- Substandard- und Fälschungserkennung
- Fehleranalyse
- Elektrische Prüfung
- Lebenszyklus- und Zuverlässigkeitstests
- AiPCBA hat 2021 ein Komponententestlabor eingerichtet
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