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TMS320DM6437ZWTQ5 Bestand und Preise

TI DSP Fixed-Point 32Bit 500MHz 4000MIPS 361Pin NFBGA
28.97
TMS320DM6437ZWTQ5
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TMS320DM6437ZWTQ5 TI
TI
  • Hersteller:
    TI
  • Hersteller-Nr:
    TMS320DM6437ZWTQ5
  • AiPCBA-Teilenummer:
    CM41261096
  • Preis (EUR):
    28.97
  • AiPCBA-Lager:
    251 Stk
  • Verfügbarkeit:
    187 Stück auf Lager
    Lagerbestand des Lieferanten, muss mit dem Verkauf bestätigt werden
  • Produktkategorie:
    Digitale Signalprozessoren (DSPs)
  • Produktbeschreibung:
    DSP Fixed-Point 32Bit 500MHz 4000MIPS 361Pin NFBGA
  • Dokumentation: 3D-Modell
TMS320DM6437ZWTQ5 Kaufen TMS320DM6437ZWTQ5 Bestand & Preis aktualisiert um 2025-06-14 03:50:22
  • Aktualisieren
    Teilenummer: TMS320DM6437ZWTQ5
    AiPCBA P/N: CM41261096
    Hersteller: TI
    Paket: NFBGA-361
    Preis
    28.97
    Gesamt: 438 Stk
    MOQ: 1
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    TMS320DM6437ZWTQ5 Spezifikationen Ähnliche Produkte anzeigen (99+)
    TYP
    BESCHREIBUNG
    AUSWÄHLEN
    Hersteller
    TI
    Kategorie
    Digitale Signalprozessoren (DSPs)
    3D-Modell
     3D-Modell
    Montagesmethoden
    Surface Mount
    Anzahl von Pins
    361 Pin
    Verpackung
    NFBGA-361
    Frequenz
    500 MHz
    Netzspannung
    2.97V (min)
    Taktfrequenz
    700 MHz
    RAM-Größe
    240 kB
    Die Anzahl der Bits
    32 Bit
    UART-Anzahl
    2 UART
    Betriebstemperatur (max.)
    125 ℃
    Betriebstemperatur (Min)
    -40 ℃
    Versorgungsspannung
    2.97V ~ 3.63V
    Versorgungsspannung (max.)
    3.63 V
    Versorgungsspannung (Min)
    2.97 V
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    TMS320DM6437ZWTQ5 Datenblatt-PDF
    TMS320DM6437ZWTQ5 Datenblatt PDF
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    2012/03/28
    Ansicht
    TMS320DM6437ZWTQ5 Benutzerreferenzhandbuch
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    2015/10/08
    Ansicht
    TMS320DM6437ZWTQ5 Benutzerreferenzhandbuch
    306 Pages, 2515 KB
    2014/09/10
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    TMS320DM6437ZWTQ5 Benutzerreferenzhandbuch
    306 Pages, 2507 KB
    Ansicht
    TMS320DM6437ZWTQ5 Anderes Datenblatt
    6 Pages, 370 KB
    2014/04/08
    Ansicht
    Größe & Paket
    TYP
    BESCHREIBUNG
    Betriebstemperatur
    -40℃ ~ 125℃
    Produktlebenszyklus
    Active
    Verpackungsmethoden
    Each
    Umwelt
    TYP
    BESCHREIBUNG
    RoHS-Standard
    RoHS Compliant
    Bleifreier Status
    Lead Free
    REACH SVHC Compliance Edition
    2015/06/15
    Exportklassifikationen
    TYP
    BESCHREIBUNG
    ECCN Code
    3A991.a.2
    Funktionsübersicht
    • The TMS320C64x+™ DSPs (including the TMS320DM6437 device) are the highest-performance fixed-point DSP generation in the TMS320C6000™ DSP platform. The DM6437 device is based on the third-generation high-performance, advanced VelociTI™ very-long-instruction-word (VLIW) architecture developed by Texas Instruments (TI), making these DSPs an excellent choice for digital media applications. The C64x+™ devices are upward code-compatible from previous devices that are part of the C6000™ DSP platform. The C64x™ DSPs support added functionality and have an expanded instruction set from previous devices.
    • Any reference to the C64x DSP or C64x CPU also applies, unless otherwise noted, to the C64x+ DSP and C64x+ CPU, respectively.
    • With performance of up to 4800 million instructions per second (MIPS) at a clock rate of 600 MHz, the C64x+ core offers solutions to high-performance DSP programming challenges. The DSP core possesses the operational flexibility of high-speed controllers and the numerical capability of array processors. The C64x+ DSP core processor has 64 general-purpose registers of 32-bit word length and eight highly independent functional units-two multipliers for a 32-bit result and six arithmetic logic units (ALUs). The eight functional units include instructions to accelerate the performance in video and imaging applications. The DSP core can produce four 16-bit multiply-accumulates (MACs) per cycle for a total of 2400 million MACs per second (MMACS), or eight 8-bit MACs per cycle for a total of 4800 MMACS. For more details on the C64x+ DSP, see the TMS320C64x/C64x+ DSP CPU and Instruction Set Reference Guide (literature number SPRU732).
    • The DM6437 also has application-specific hardware logic, on-chip memory, and additional on-chip peripherals similar to the other C6000 DSP platform devices. The DM6437 core uses a two-level cache-based architecture. The Level 1 program memory/cache (L1P) consists of a 256K-bit memory space that can be configured as mapped memory or direct mapped cache, and the Level 1 data (L1D) consists of a 640K-bit memory space-384K-bit of which is mapped memory and 256K-bit of which can be configured as mapped memory or 2-way set-associative cache. The Level 2 memory/cache (L2) consists of a 1M-bit memory space that is shared between program and data space. L2 memory can be configured as mapped memory, cache, or combinations of the two.
    • The peripheral set includes: 2 configurable video ports; a 10/100 Mb/s Ethernet MAC (EMAC) with a management data input/output (MDIO) module; a 4-bit transmit, 4-bit receive VLYNQ interface; an inter-integrated circuit (I2C) Bus interface; two multichannel buffered serial ports (McBSPs); a multichannel audio serial port (McASP0) with 4 serializers; 2 64-bit general-purpose timers each configurable as 2 independent 32-bit timers; 1 64-bit watchdog timer; a user-configurable 16-bit host-port interface (HPI); up to 111-pins of general-purpose input/output (GPIO) with programmable interrupt/event generation modes, multiplexed with other peripherals; 2 UARTs with hardware handshaking support on 1 UART; 3 pulse width modulator (PWM) peripherals; 1 high-end controller area network (CAN) controller [HECC]; 1 peripheral component interconnect (PCI) [33 MHz]; and 2 glueless external memory interfaces: an asynchronous external memory interface (EMIFA) for slower memories/peripherals, and a higher speed synchronous memory interface for DDR2.
    • The DM6437 device includes a Video Processing Subsystem (VPSS) with two configurable video/imaging peripherals: 1 Video Processing Front-End (VPFE) input used for video capture, 1 Video Processing Back-End (VPBE) output.
    • The Video Processing Front-End (VPFE) is comprised of a CCD Controller (CCDC), a Preview Engine (Previewer), Histogram Module, Auto-Exposure/White Balance/Focus Module (H3A), and Resizer. The CCDC is capable of interfacing to common video decoders, CMOS sensors, and Charge Coupled Devices (CCDs). The Previewer is a real-time image processing engine that takes raw imager data from a CMOS sensor or CCD and converts from an RGB Bayer Pattern to YUV422. The Histogram and H3A modules provide statistical information on the raw color data for use by the DM6437. The Resizer accepts image data for separate horizontal and vertical resizing from 1/4x to 4x in increments of 256/N, where N is between 64 and 1024.
    • The Video Processing Back-End (VPBE) is comprised of an On-Screen Display Engine (OSD) and a Video Encoder (VENC). The OSD engine is capable of handling 2 separate video windows and 2 separate OSD windows. Other configurations include 2 video windows, 1 OSD window, and 1 attribute window allowing up to 8 levels of alpha blending. The VENC provides four analog DACs that run at 54 MHz, providing a means for composite NTSC/PAL video, S-Video, and/or Component video output. The VENC also provides up to 24 bits of digital output to interface to RGB888 devices. The digital output is capable of 8/16-bit BT.656 output and/or CCIR.601 with separate horizontal and vertical syncs.
    • The Ethernet Media Access Controller (EMAC) provides an efficient interface between the DM6437 and the network. The DM6437 EMAC support both 10Base-T and 100Base-TX, or 10 Mbits/second (Mbps) and 100 Mbps in either half- or full-duplex mode, with hardware flow control and quality of service (QOS) support.
    • The Management Data Input/Output (MDIO) module continuously polls all 32 MDIO addresses in order to enumerate all PHY devices in the system.
    • The I2C and VLYNQ ports allow DM6437 to easily control peripheral devices and/or communicate with host processors.
    • The high-end controller area network (CAN) controller [HECC] module provides a network protocol in a harsh environment to communicate serially with other controllers, typically in automotive applications.
    • The rich peripheral set provides the ability to control external peripheral devices and communicate with external processors. For details on each of the peripherals, see the related sections later in this document and the associated peripheral reference guides.
    • The DM6437 has a complete set of development tools. These include C compilers, a DSP assembly optimizer to simplify programming and scheduling, and a Windows™ debugger interface for visibility into source code View datasheet View product folder

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      - 500 m² Labor für fortschrittliche Komponententests, Fälschungserkennung, RoHS-konform usw.
      - 2000 m² digitales Komponentenlager, konstante Temperatur und Luftfeuchtigkeit
      - Entkapselungsinspektion
      - Röntgeninspektion
      - XRF-Inspektion
      - Elektrische Prüfung
      - Oberflächenprüfung
    • - Substandard- und Fälschungserkennung
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      - Elektrische Prüfung
      - Lebenszyklus- und Zuverlässigkeitstests
      - AiPCBA hat 2021 ein Komponententestlabor eingerichtet
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